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« Modèle:Palette Technologies CPU » : différence entre les versions

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+ ajout Circuiterie et unité
Ligne 6 : Ligne 6 :
* [[Chronologie des microprocesseurs]]
* [[Chronologie des microprocesseurs]]
* [[Semi-conducteur]]
* [[Semi-conducteur]]
* [[Transistor]]
}}
}}


Ligne 32 : Ligne 33 :
| liste2 = {{Méta palette de navigation sous-groupe
| liste2 = {{Méta palette de navigation sous-groupe
| stylegroupe = width:75px;
| stylegroupe = width:75px;
| styleliste = text-align:left;


| groupe1 = Général
| groupe1 = Général
Ligne 67 : Ligne 67 :
| liste3 = {{Méta palette de navigation sous-groupe
| liste3 = {{Méta palette de navigation sous-groupe
| stylegroupe = width:75px;
| stylegroupe = width:75px;
| styleliste = text-align:left;


| groupe1 = [[Jeu d'instructions|Jeu]]
| groupe1 = [[Jeu d'instructions|Jeu]]
Ligne 116 : Ligne 115 :
* [[Prédiction de branchement]]
* [[Prédiction de branchement]]
* [[Exécution spéculative]]
* [[Exécution spéculative]]
* [[File (structure de données)|File]]
}}
}}


Ligne 129 : Ligne 129 :
| liste4 = {{Méta palette de navigation sous-groupe
| liste4 = {{Méta palette de navigation sous-groupe
| stylegroupe = width:75px;
| stylegroupe = width:75px;
| styleliste = text-align:left;


| groupe1 = Général
| groupe1 = Général
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}}
}}


| groupe7 = Circuiterie
| groupe7 = [[Circuit électronique|Circuiterie]] et unité
| liste7 = {{Liste horizontale|
| liste7 = {{Méta palette de navigation sous-groupe
| stylegroupe = width:75px;

| groupe1 = Général
| liste1 = {{Liste horizontale|
* [[Circuit intégré]]
** [[Circuit intégré à signaux mixtes|Signaux mixtes]]
* [[Circuit booléen]]
* [[Interrupteur]]
* [[Électronique analogique]]
* [[Processeur#Microprocesseurs|Cœur]]
* [[Mémoire cache|Cache]]
** [[Cache de processeur|Processeur]]
** [[Algorithme de mise en cache|Algorithme]]
** [[Protocole de cohérence de cache|Cohérence]]
* [[Bus informatique|Bus]]
}}

| groupe2 = [[Unité d'exécution|Exécution]]
| liste2 = {{Liste horizontale|
* [[Unité arithmétique et logique]] (ALU)
* [[Unité de calcul en virgule flottante]] (FPU)
* [[Unité de gestion de mémoire]] (MMU)
** [[Translation lookaside buffer]] (TLB)
* [[Prédiction de branchement]]
* [[Contrôleur mémoire]]
}}

| groupe3 = [[Porte logique]]
| liste3 = {{Liste horizontale|
* [[Fonction logique|Combinatoire]]
* [[Logique séquentielle|Séquentielle]]
* [[Porte quantique|Quantique]]
}}

| groupe4 = Registre
| liste4 = {{Liste horizontale|
* [[Registre de processeur]]
* [[Registre d'état]]
* [[Banc de registres]]
* [[Registre à décalage]]
* [[Registre Tampon Mémoire|Registre tampon mémoire]]
* [[Registre d'Adresse Mémoire|Registre d'adresse mémoire]]
* [[Compteur ordinal]]
}}

| groupe5 = [[Unité de contrôle|Contrôle]]
| liste5 = {{Liste horizontale|
* [[Mémoire tampon]]
* [[Microprogrammation]]
* [[Image ROM]]
* [[Compteur]]
}}

| groupe6 = [[Chemin de données]]
| liste6 = {{Liste horizontale|
* [[Multiplexeur]]
* [[Multiplexeur]]
* [[Démultiplexeur]]
* [[Additionneur]]
* [[Additionneur]]
* [[Multiplieur]]
* [[Multiplieur]]
* [[Coefficient multiplicateur (informatique)|Coefficient multiplicateur]]
* [[Barrel shifter|Décaleur]]
* [[Barrel shifter|Décaleur]]
}}
* [[Registre de processeur|Registre]]
* [[Registre à décalage]]
}}
}}



Version du 16 mars 2024 à 12:25

 Documentation de palette[créer] [purger]

Ceci est la documentation du modèle {{Palette Technologies CPU}}.

Syntaxe

L’utilisation de cette palette se fait par l’ajout, en fin de page, avant les portails, du code {{Palette|Technologies CPU}}, ou en l’ajoutant à une ou des palettes existantes sous la forme {{Palette|nom-palette-1|Technologies CPU}}.

Il est déconseillé d’utiliser la forme {{Palette Technologies CPU}}, qui ne permet pas, contrairement au modèle {{Palette}}, de séparer correctement la ou les palettes du texte qui précède par de l’espace vide.